冗長アルゴリズム逐次比較近似ADCでのコンパレータ・オフセットのデジタル補正技術(若手研究会)
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概要
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この論文では,冗長アルゴリズムを用いることで逐次比較近似(SAR)ADCの低消費電力化を実現できる方式を提案する.そこではデジタル誤差補正を行うことでアナログ校正が不要になる.(1)冗長アルゴリズムSAR ADCで2つのダイナミック・コンパレータをもち,逐次比較のステップの前半で低消費電力・高ノイズ,後半で高消費電力・低ノイズのコンパレータを用いる.前半でのステップでのノイズによるコンパレータ誤判定,2つのコンパレータのオフセット・ミスマッチ間の影響は冗長アルゴリズムによるデジタル演算で補正できる.通常のSAR ADCの全てのステップで高消費電力・低ノイズのコンパレータを使用する場合に比べて低消費電力化が図れる. (2)低消費電力化が図れる電荷共有2進SAR ADCでは,コンパレータのオフセットによりADC全体の線形性が劣化する.ここでは冗長アルゴリズムSAR ADCを用いることでこのオフセットの影響がデジタル補正できることを示す(オフセットのアナログ校正は必要ない). (3)また(1), (2)を組み合わせて,ダイナミック・コンパレータ2個で電荷共有SAR ADCを冗長アルゴリズムを用いて実現することで,さらに低消費電力化する.
- 社団法人電子情報通信学会の論文
- 2009-12-07
著者
-
小林 春夫
群馬大学大学院工学研究科電気電子工学専攻
-
傘 昊
群馬大学大学院工学研究科電気電子工学専攻
-
高井 伸和
群馬大学大学院工学研究科電気電子工学専攻
-
堀田 正生
東京都市大学
-
傘 昊
東京都市大学
-
小川 智彦
群馬大学大学院工学研究科電気電子工学専攻
-
小林 春夫
群馬大学 工学部
-
松浦 達治
ルネサステクノロジ
-
小林 春夫
群馬大学大学院 工学研究科 電気電子工学専攻
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