3次元DCTを効率的に処理するア***ロセッサのFPGA実装(アプリケーション1,FPGA応用及び一般)
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概要
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従来のア***ロセッサでは3次元DCTを行うためにメモリ上に格納した係数と入力データに何度もランダムにアクセスする必要があり,データアクセス自体が高速計算を妨げていた.本稿では3次元DCTに特化した3次元ア***ロセッサを提案する.本ア***ロセッサでは計算処理中のデータの移動・再配置を大幅に削減することで,処理全体のパフォーマンスを大きく向上させている.N×N×N個の入力データに3次元DCTを行うための計算量は,直接計算ではO(N^4)であるのに対し,提案ア***ロセッサではO(N)で行うことができる.ここでは実装を考慮し,本ア***ロセッサに特化したI/O機構,回路面積を改善した機構についても議論する.またFPGAへの実装結果を示し,本機構が高い拡張性を備えた上で,十分なリアルタイム処理性能を持つことを示す.
- 2010-01-19
著者
-
宮崎 敏明
会津大学大学院コンピュータ理工学研究科
-
宮崎 敏明
会津大学コンピュータ理工学部
-
生垣 佑樹
会津大学大学院コンピュータ理工学研究科
-
Sedukhin Stanislav
会津大学大学院コンピュータ理工学研究科
-
五十嵐 裕之
会津大学コンピュータ理工学部
-
生垣 佑樹
会津大学コンピュータ理工学研究科
-
sedukhin Stanislav
会津大学コンピュータ理工学研究科
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