FIFOを用いて実現するア***ロセッサのための効率的なデータ入出力機構の提案(高速データ通信と実装,FPGA応用及び一般)
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概要
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信号処理や画像処理を行なうア***ロセッサは,扱うデータ量が多いため,効率的にデータの入出力を行なう必要がある.本稿では,FIFOを用いることでデータの入出力を効率的に行なう機構を提案する.入力行列と途中結果を保持するために複数本のFIFOを用意する.それらをタイミングよく切り替え,ア***ロセッサへのデータ転送を行なうことで,ア***ロセッサのボトルネックである外部メモリとの通信をなくし,入出力効率を上げることができる.
- 2008-01-10
著者
-
宮崎 敏明
会津大学大学院コンピュータ理工学研究科
-
宮崎 敏明
会津大学コンピュータ理工学部
-
佐藤 由香
会津大学
-
野本 裕輔
会津大学大学院コンピュータ理工学研究科
-
佐藤 由香
会津大学大学院コンピュータ理工学研究科
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