ダイナミック光再構成アーキテクチュアの連続再構成における保持時間の解析(動的再構成技術とその応用,FPGA応用及び一般)
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概要
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近年,高速再構成可能なデバイスの研究開発が活発化している.我々はそのような中で光を使い2次元的に高速再構成が可能な光再構成型ゲートアレイについて研究を進めている.その光再構成型ゲートアレイにおいて,我々は回路情報を読み取るフォトダイオードを回路情報を保持するメモリとしても使用することによって,大規模なゲート数を実現するダイナミック光再構成アーキテクチュアを提案している.しかし,このアーキテクチュアではある回路の動的再構成処理の回折光が他の動作中の回路の保持時間に悪影響を与えることが懸念されていた.そこで,動作中の回路の近傍で動的再構成を行い、その動作中の回路が受ける影響について調査した。本稿ではこの試験結果を示し、連続再構成下においてもダイナミック光再構成アーキテクチュアが有効であることを示す.
- 一般社団法人電子情報通信学会の論文
- 2008-01-10
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