異種命令セット同時実行プロセッサの実装に向けた評価(プロセッサアーキテクチャ)
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概要
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近年,携帯機器などの機能向上が激しく,これに用いられるプロセッサは,高性能化と低消費エネルギーの両立を要求されている.我々は,これに応える1方式としてVLIWバックエンド上に異なる命令セットのSMT (Simultaneous Multi-Threading)を構成するOROCHIプロセッサを提案し開発を行っている.プロセッサを実装するにあたり,その独特な構造による性能と面積のトレードオフが多数存在しており,それらを適切に実装しなければ,本来のパフォーマンスを得ることができない.本稿では,これら性能と面積のトレードオフについてまとめ,その中の特徴の異なるスレッド間の競合によるキャッシュヒット率の評価を行うとともに,他のスレッドのパイプラインのストールがどの程度影響を与えているか評価を行う.
- 一般社団法人情報処理学会の論文
- 2007-11-21
著者
-
北村 俊明
広島市立大学大学院情報科学研究科
-
田端 猛一
広島市立大学大学院情報科学研究科
-
北村 俊明
広島市立大学
-
北村俊明
広島市立大学情報科学研究科
-
塩田 耕太郎
広島市立大学情報科学部
-
北村 俊明
広島市立大学情報科学部情報工学科
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