PLL,DLL技術にみる高性能化動向(PLL,クロック,VLSI回路,デバイス技術(高速,低電圧,低消費電力))

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概要

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• 位相同期回路(PLL)や遅延同期回路(DLL)は、通信機器やシステムLSIの高性能化に伴い、近年最も進歩した回路の一つである。また、その高性能化に伴い位相ノイズの予測技術も非常に進歩した。現在では、ほぼ予測どおりのジッタ特性をもつ回路が設計できるまでになっている。本論文ではPLLおよびDLLの高性能化動向と位相ノイズの予測技術について概説する。具体的には、ループフィルタ技術、アダプティブバイアス技術、分数分周技術等である。

• 2007-08-16

著者

• 道正 志郎

  松下電器産業(株) 戦略半導体開発センタ

• 道正 志郎

  松下電器産業(株)戦略半導体開発センタ

• 道正 志郎

  松下電器産業 半導体社 開発本部 Lsi先行開発センタ

• 道正 志郎

  松下電器産業(株)半導体開発本部半導体先行開発センタ

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