動作合成による倍精度浮動小数点型加算器の設計事例(高位合成)
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概要
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近年,FPGAの容量の増加に伴い,浮動小数点型演算IPをFPGAに組み込めるようになってきた.しかし,依然としてそのコストが高いことが問題視されている.本論文では,動作合成を用いて,倍精度浮動小数点型の加算器および加減算器を設計した事例を報告する.動作合成において様々な工夫を行い,同じCプログラムから15通りの加算器と21通りの加減算器を設計する.実験結果から,動作合成の有効性ならびに動作合成における各種最適化技術の有効性を示す.
- 2007-01-22
著者
-
本田 晋也
名古屋大学大学院情報科学研究科附属組込みシステム研究センター
-
高田 広章
名古屋大学大学院情報科学研究科附属組込みシステム研究センター
-
冨山 宏之
名古屋大学大学院情報科学研究科情報システム学専攻
-
高田 広章
名古屋大学
-
原 祐子
名古屋大学大学院情報科学研究科
-
石井 克哉
名古屋大学情報連携基盤センター
-
冨山 宏之
名古屋大学
-
冨山 宏之
財団法人九州システム情報技術研究所
-
石井 克哉
名古屋大学情報基盤センター
-
石井 克哉
名大情基セ
-
本田 晋也
名古屋大学大学院情報科学研究科
-
本田 晋也
名古屋大学
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