FPGAを用いたAES暗号の試作
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概要
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近年, コンピュータの飛躍的な進化などにより米IBM社が開発したDESの安全性が低下をしている.そこで, NISTは, 1997年に世界中からAESのアルゴリズムを公募した.そして, 昨年10月にRijndaelがAES暗号として採用された.本研究では, このAES暗号をFPGAを用いてハードウェア化するため, 回路設計を行ってきた結果, 暗号化及び復号回路を一体化してVirtex XCV300PQ240-4を用いて実現することが可能となった.そこで本稿では, Virtex XCV300PQ240-4を実装した評価用ボードを用いて, 設計した回路の動作確認をPCをホストマシンとして行った.その結果, AES暗号回路の正常動作を確認することができた。
- 社団法人電子情報通信学会の論文
- 2001-11-22
著者
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