digitシリアル演算を用いたDSPシステム設計最適化の一手法
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概要
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本稿ではdigitシリアル演算を用いて, スループット制約を満たし, 最小ハードウェアコストでDSPシステム構成を実現するための一手法を提案する.本稿での提案手法では, DSPシステム内での演算単位であるdigitサイズを効果的に変更することでハードウェアコスト・スループットのトレードオフを考慮した設計を可能とする.評価実験より, digitサイズを変化させることによりハードウェアコスト・スループット間にはトレードオフが存在することが確認され, スループット制約条件下において最適構成の選択が可能であることが確認された.
- 社団法人電子情報通信学会の論文
- 2001-01-05
著者
-
武内 良典
大阪大学 大学院情報科学研究科
-
今井 正治
大阪大学 大学院情報科学研究科
-
今井 正治
大阪大学 大学院 基礎工学研究科
-
渡辺 義治
大阪大学大学院基礎工学研究科情報数理系専攻
-
北嶋 暁
大阪電気通信大学 総合情報学部情報工学科
-
渡辺 義治
大阪大学 大学院基礎工学研究科 情報数理系専攻
-
北嶋 暁
大阪大学 大学院基礎工学研究科 情報数理系専攻
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