ASIP開発システムPEAS-IIIのための命令セットレベルシミュレータの自動生成
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概要
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ASIP開発システムPEAS-IIIで入力されたパイプラインプロセッサの仕様記述から命令セットレベルシミュレータを生成する手法を考案した.本手法では, 各パイプラインステージを同一のモデルで表現し, そのモデルをSW言語で記述することによりシュミレータを実現する.モデルの記述言語にはSystemCを用いる。これにより, 並列動作するパイプラインステージのSW言語によるモデリングが容易に行え, またサイクル単位のシミュレーションを行うカーネルを利用することで, パイプライン動作を正確かつ短時間でシミュレート可能となる.評価実験により, PEAS-IIIの生成したプロセッサに対し, 本手法により生成されたシミュレータは, VHDLシミュレーションと比較し実行サイクル数の見積りを約1 / 7の時間で行えることを示した。
- 一般社団法人情報処理学会の論文
- 2000-05-11
著者
-
武内 良典
大阪大学 大学院情報科学研究科
-
今井 正治
大阪大学 大学院情報科学研究科
-
今井 正治
大阪大学 大学院 基礎工学研究科
-
前田 友英
大阪大学 大学院基礎工学研究科 情報数理系専攻
-
前田 友英
大阪大学大学院基礎工学研究科情報数理系専攻
-
北嶋 暁
大阪電気通信大学 総合情報学部情報工学科
-
北嶋 暁
大阪大学 大学院基礎工学研究科 情報数理系専攻
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