ハードウェアによる通信プロトコル処理の検討
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概要
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現在,データ通信の比較的下位レイヤについてはATMインタフェースやHIPPIによって高速化が図られている.それに伴い,その上位レイヤのプロトコル処理時間によるボトルネックが問題となっている.現在でも短フレームが連続するような状況下でのスループットは通常低い.マイクロプロセッサを用いた通信プロトコル処理装置では,処理は逐次手的に行われ,高速化のために並列化を行うにしても送信・受信のような粒度の大きな並列化にとどまる.また,外部メモリアクセスがボトルネックとなりプロセッサの高クロックサイクル化が活かせない場合もある.本稿ではメモリアクセスの問題の解決,粒度の細かな並列処理による高速化をねらいとしたハードウェアによる通信プロトコル処理について報告する.
- 社団法人電子情報通信学会の論文
- 1995-03-27
著者
-
松田 和浩
Ntt情報流通プラットフォーム研究所
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松田 隆男
NTTネットワークサービスシステム研究所
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松田 和浩
NTTネットワークサービスシステム研究所
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松田 隆男
日本電信電話株式会社NTTネットワークサービスシステム研究所
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