配線処理専用ハードウェアのチップ試作
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概要
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LSIレイアウト設計による配線問題は、ソフトウェアにより逐次的に処理を行っているため、LSIの大規模化に伴う配線エリアや複雑度の増大によって膨大な処理時間を要していた。従来からある配線処理手法に、線分探索法(LineSearch)、迷路法(Maze)があるが、計算時間・メモリ使用量などの問題点があげられる。そこで、今回の試作では極力ソフトウェアとのインターフェイスに依存しない回路を設計することを目的としつつ、前進探索にMaze、後進探索にLineSearchを採用した手法に基づき専用ハードウェア化し、並列処理をすることによってLSI配線処理の高速化を試みた。
- 社団法人電子情報通信学会の論文
- 1996-03-11
著者
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上田 和宏
芝浦工業大学システム工学部電子情報システム学科
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上田 和宏
芝浦工大
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大谷 隆之
芝浦工業大学システム工学部
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日下 明隆
芝浦工業大学 システム工学部
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榎本 満
芝浦工業大学システム工学部
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鶴岡 尚幸
芝浦工業大学システム工学部
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日下 明隆
芝浦工業大学システム工学部
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上田 和宏
芝浦工業大学システム工学部
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