並列階層キャッシュの性能とキャッシュ・ミスの分類
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概要
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並列推論マシンPIM/kが採用している並列階層キャッシュは、バス共有の密結合並列計算機のバス・ボトルネックの解消を目的とするアーキテクチャである。PIM/kやその上のKL1処理系開発のため、シミュレ一ションによる性能評価を行なっている。PIM/k上のKL1処理系の評価に先立ち、並列階層キャッシュの特性の一般的傾向を理解するための評価を行なった。本稿は、キャッシュ・ミスを要因により分類し、それらがシステム性能に与える影響を調べたシミュレ-ション結果に関するものである。なお、本研究は、通産省第5世代コンビュータプロジェクトの一環である。
- 一般社団法人情報処理学会の論文
- 1990-09-04
著者
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