有馬 幸生 | (株)半導体理工学研究センター(starc)設計技術開発部低電力技術開発室
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概要
関連著者
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著作論文
- A 9μW 50MHz 32b Adder Using a Self-Adjusted Forward Body Bias in SoCs(VSLI一般(ISSCC'03関連特集))
- 90nm以後のプロセスに適応可能な宇宙線への耐性を備えたラッチ回路(VLSI一般 : ISSCC2004特集)
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