H.264/AVCにおけるデブロッキングフィルタの低消費電力化実装手法(画像処理回路,システムオンシリコンを支える設計技術)
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概要
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動画像符号化方式H.264/AVCはワンセグ放送,携帯電話など様々な携帯端末に使用されているが,低消費電力化が重要な課題となっている.特にH.264/AVCデコーダの全演算量の約30〜50%を占めるデブロッキングフィルタ処理の低消費電力化が重要となる.本研究では,フィルタリング強度を求める際に,冗長な計算が行われていることに注目し,フィルタリング強度の早期判定手法と,そのアーキテクチャを提案する.また,効率的にフィルタリング処理を行うアーキテクチャを提案する.提案アーキテクチャをFPGA(Xilinx Virtex5)で実装した結果,ゲート数は15.5K,また最大動作周波数100MHzで動作可能である.シミュレーション結果により,提案手法を用いる場合,フィルタリング強度の計算量において最大93.4%の削減を実現し,デブロッキングフィルタ処理の低消費電力化が実現可能となった.
- 2009-03-04
著者
-
宋 天
徳島大学大学院ソシオテクノサイエンス研究部
-
島本 隆
徳島大学大学院ソシオテクノサイエンス研究部
-
宋 天
徳島大学大学院 ソシオテクノサイエンス研究部
-
林 良典
徳島大学大学院先端技術科学教育部
-
秋田 朋洋
徳島大学大学院先端技術科学教育部
-
島本 隆
徳島大学大学院 ソシオテクノサイエンス研究部
-
宋 天
徳島大学大学院
-
Shimamoto Takashi
Graduate School Of Advanced Technology And Science The University Of Tokushima
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