モバイルマルチメディア処理向けのスケーラブルなマルチプロセッサ(マルチコア設計開発/性能評価,集積回路とアーキテクチャの協創〜どう繋ぐ?どう使う?マルチコア〜)
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概要
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モバイルマルチメディア処理向けのマルチプロセッサを開発した.各コアは32ビットRISCプロセッサに加え,SIMD命令を実行可能なVLIWコプロセッサを持ち,広帯域のL2キャッシュを共有している.対称かつ粗粒度な並列化方法の採用により,コア数に対する性能のスケーラビリティを実現できる.65nm CMOSプロセスで試作したチップでは8個のコアと512KBのL2キャッシュを持ち,8コアでの実行時にH.264 720p 60fpsのデコードが可能である.これは1コアでの実行時と比較して7.5倍の性能である.
- 2008-05-06
著者
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薄井 弘之
株式会社東芝
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野村 周央
株式会社東芝
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山根 史之
株式会社東芝
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宮本 幸昌
株式会社東芝
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カムトーンキッティクン チャイヤスィット
株式会社東芝
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田辺 淳
株式会社東芝
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内山 真郷
株式会社東芝
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宮森 高
株式会社東芝
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坪井 芳郎
株式会社東芝
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