FPGA上のSATソルバPCMGTPへの前処理の導入
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概要
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This paper describes a preprocessing method for the SAT solver PCMGTP implemented on an FPGA chip. In PCMGTP, each problem is transformed into an HDL code so as to solve the problem directly on an FPGA. It is time consuming to compile an HDL code to a hardware circuit for the FPGA, while its deduction is at speed. Preprocessing SAT problems can sometimes reduce their search space and size considerably. Applying the preprocessing method to SAT problems not only decreases runtime for solving them, but also reduces their circuit size and compilation time. Experimental results show significant performance in solving some benchmark SAT problems.
- 九州大学の論文
著者
-
藤田 博
九州大学大学院システム情報科学研究院
-
越村 三幸
九州大学大学院システム情報科学研究院
-
松田 純一
九州大学大学院システム情報科学府知能システム学専攻
-
藤田 博
九州大学大学院システム情報科学研究科
-
Koshimura Miyuki
Dept.of Intelligent Systems Faculty Of Information Science And Electrical Eng. Kyushu Univ.
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