超低演算量な動き検出アルゴリズムと専用プロセッサへの実装(プロセッサ, DSP, 画像処理技術及び一般)
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概要
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本稿では, 動画圧縮に必要な動き検出について超低演算量なアルゴリズムと, このアルゴリズムに最適な専用プロセッサの回路設計とソフトウエア実装について述べる.動き検出アルゴリズムはブロック内の画素レベルの変動状況に応じて計算対象になる画素の間引き率を適応的に変える手法を提案し, その他の手法と組み合わせて, 全探索に比べて1000分の1の以下計算量となるアルゴリズムを開発した.また, このアルゴリズムを効率よく実行するために付加演算器をライトバックステージに追加した専用プロセッサを提案し, プロセッサの回路をFPGAで設計し, ソフトウエアを実装した.本プロセッサは従来の動き検出専用プロセッサに比べて4分の1以下回路規模で実現できるので, コンパクトな動画圧縮システムの開発に寄与が期待できる.
- 社団法人電子情報通信学会の論文
- 2005-10-13
著者
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