素子の微細化がアナログCMOS回路に及ぼす影響についての研究 : CMOS演算増幅器及びパイプライン型ADC性能のデザインルール依存性(アナログ・デジアナ・センサ, 通信用LSI)
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概要
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0.35μmから90nmまでのCMOSデバイスの代表的アナログ特性をキャラクタライズし、代表的な演算増幅器とこれを用いたパイプライン型ADCの特性への影響を理論及びシミュレーションにより検討した。その結果、帰還容量よりもトランジスタの寄生容量が小さい時のみ消費電力を増加させることでADCの変換周波数を大きくできることがわかった。低い分解能においては帰還容量が小さいため寄生容量が小さい微細なルールが有効であり、高い分解能においては帰還容量が支配的となるため、信号振幅を大きくとり帰還容量を小さくすることのできる比較的緩いデザインルールが有効であることがわかった。
- 社団法人電子情報通信学会の論文
- 2005-07-08
著者
-
宮原 正也
東京工業大学電子物理工学専攻
-
松澤 昭
東京工業大学電子物理工学専攻
-
倉科 隆
東京工業大学大学院理工学研究科電子物理工学専攻
-
松澤 昭
東京工業大学
-
宮原 正也
東京工業大学大学院理工学研究科
-
宮原 正也
東京工業大学 大学院理工学研究科 電子物理工学専攻
-
宮原 正也
東京工業大学
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