10bit 120MSample/s低消費電力パラレルパイプラインA/D変換器(アナログ・デジアナ・センサ,通信用LSI)
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概要
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分解能10bit、変換周波数120MHzの並列パイプラインA/D変換器の設計と試作について述べる。デジタル補正技術はアナログ回路の精度要求を緩和し、効果的に消費電力を低減するための有効な手法であり、本ADCにおいてはデジタル補正を徹底的に使用している。また、キャパシタミスマッチを外部から推定する新しいデジタル誤差測定手法を適用した。各チャネルのADCには、低消費電力擬似差動パイプラインADCを使用している。試作した0.3um CMOSによる4チャネル動作、10bit、120MSample/sにおいて、75mWの消費電力を実現した。入力周波数が2MHz時のSNDRは57.1dBである。
- 2003-09-04
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