断熱的ダイナミックCMOS論理回路
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概要
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超低消費電力論理回路として断熱的ダイナミックCMOS論理(ADCL)回路を提案し, 回路解析, 計算機シミュレーションおよび個別素子を用いた実験によって, その有効性を確認した.論理回路の相互接続の容易性はCMOSに近く, かつ消費エネルギーはCMOSより2けたほど低い値が得られた.W/L=10μ/1.5μFETを用い, 負荷容量として0.1pFを付けたインバータ回路では電源のクロック周波数が1MHz, 電圧振幅が5Vの三角波であるとき1動作当りの消費エネルギーは0.39pJであった.これに対して電源電圧5V, かつ同一の入力信号電圧でCMOSインバータでは23pJであった.
- 社団法人電子情報通信学会の論文
- 1998-10-25
著者
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