断熱的ダイナミックCMOS論理回路
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概要
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超低消費電力論理回路として断熱的ダイナミックCMOS論理回路(ADCL)を提案し, 回路解析, 計算機シミュレーションおよび個別素子を用いた実験によって, その有効性を確認した. 論理回路の相互接続の容易性はCMOSに近く, かつ消費エネルギはCMOSより2桁ほど低い値が得られた. W/L=10μ/1.5μMOSFETを用い, 負荷容量として0.1pFをつけたインバータ回路では電源のクロック周波数が1MHz, 電圧振幅が5Vの三角波であるとき1動作あたりの消費エネルギは0.39pJであった. これに対して電源電圧5V, かつ同一の入力信号電圧のCMOSインバータ回路では23pJであった.
- 社団法人電子情報通信学会の論文
- 1997-09-26
著者
-
小澤 健太郎
山形大学工学部電子情報工学科
-
水沼 充
山形大学工学部応用生命システム工学科
-
高橋 一清
山形大学工学部応用生命システム工学科
-
高橋 一清
山形大
-
高橋 一清
山形大学工学部 応用生命システム工学科
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