FPGAによるリアルタイム制御回路用のFail Safe回路
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概要
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動的書換え可能なFPGAを利用したリアルタイム制御回路用のFail Safe回路を提案する.最近のFPGAの中にはチップ全体の書換えを1ms以内で行うことが可能なデバイスが開発されている.この高速な書換え機能を生かして, 正常動作時にはFPGAを故障検出回路として構成し, 故障検出後にはFPGAをBack Up回路に再構成するFail Safe回路を提案する.複数のリアルタイム制御回路に対して一つのFPGAでFail Safe機能を提供できるため, 提案する回路を利用した場合, 個別にFail Safe回路を用意する従来に比べ, 低コスト化, 小型化が可能である.
- 1998-12-10
著者
-
大熊 繁
名古屋大学
-
橋山 智訓
名古屋市立大学大学院システム自然科学研究科
-
橋山 智訓
(財)名古屋産業科学研究所
-
古橋 武
名古屋大学工学研究科計算理工学専攻
-
中條 直也
豊田中央研究所
-
中條 直也
(株)豊田中央研究所
-
古橋 武
(財)名古屋産業科学研究所
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