高速MLSE型等化器LSI
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概要
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数Mbit/s〜数十Mbit/sの信号に対して, 1チップでリアルタイム処理可能な高速のMLSE(Maximum Likelihood Sequence Estimation)型適応等化器(VLMS-LSI)を開発した. 本LSIは遅延時間差が1シンボル周期程度の遅延波等化機能と, 2ブランチ合成ダイバーシチ機能を有する. 本LSIの回路規模は約70kgateであり, 電源電圧は3.3V単一で動作する. 特性評価のため一例として, 6.144Mbit/s-QPSK実験系を用いて2波等レベル独立レーリーフェージング下での特性を測定し, ビット誤り率のフロアがシングルブランチの場合で10^<-5>以下, 合成ダイバーシチの場合10^<-6>以下に抑圧できることを確認した. また54.912Mbit/s-QPSKに対する基本特性を確認し, 高速信号伝送への適用の可能性を明らかにした. なお消費電力はビットレートに比例し, 10Mbit/sの場合で170mWであった.
- 社団法人電子情報通信学会の論文
- 1997-09-24
著者
-
田野 哲
ATR環境適応通信研究所
-
小林 聖
NTTワイヤレスシステム研究所
-
生越 重章
NTTワイヤレスシステム研究所
-
白戸 裕史
NTTワイヤレスシステム研究所
-
田野 哲
NTTグループ企業本部
-
生越 重章
香川大 工
-
白戸 裕史
Ntt未来ねっと研究所 ワイヤレスシステムイノベーション研究部
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