3値論理回路を用いた非同期式システムの一構成法
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概要
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VLSIが高速化、大規模化するに伴いシステム全体を制御する同期クロックのスキュー問題が深刻になってきた。これは、素子遅延に比べて、配線遅延が無視できなくなることに起因する。これに対して、種々の構成法が提案されている。本稿では、3値論理回路を用いた2相非同期システムを提案し、これによりバイナリデータを非同期で処理する過程を、加算器を例にシミュレーションしその有効性を示した。
- 社団法人電子情報通信学会の論文
- 1996-03-11
著者
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長田 康敬
琉球大学工学部
-
我那覇 隆清
琉球大学 工学部
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長田 康敬
琉球大学 工学部
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大城 健史
琉球大学 工学部
-
宮城 省司
琉球大学 工学部
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安冨祖 忠信
琉球大学 工学部
-
安冨祖 忠信
琉球大学工学部 電気電子工学科
-
安富祖 忠信
琉球大
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