V830による可変長復号の高速実現
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概要
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The 32-bit RISC microprocessor V830offers architectural enhancements for signal processing tasks. This paper describes efficient implementation of MPEG-1Variable Length Decoding (VLD) on the V830architecture derived from MPEG-1software decoder mpeg_p1ay.
- 社団法人電子情報通信学会の論文
- 1996-03-11
著者
-
黒田 一朗
NECエレクトロニクス株式会社 基盤技術開発本部 技術企画室
-
黒田 一郎
NEC情報通信メディア研究本部
-
シュトルベルグ ハンスヨアヒム
NEC情報メディア研究所
-
撫原 恒平
NEC情報メディア研究所
-
黒田 一郎
Nec情報メディア研究所
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