CAS2000-33 / VLD2000-42 / DSP2000-54 VLSI回路規模を考慮した信号語分割フィルタの設計
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概要
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信号語分割フィルタの設計において、従来のように回路規模を表す要素としてフィルタに含まれる乗算器の全加算器だけ考慮するのではなく、乗算器以外の構成要素である加算器や遅延器の回路規模をも考慮したフィルタ設計手法を提案する。提案する手法は、従来の設計法に上位ビット側フィルタのフィルタ係数と下位ビット側フィルタのフィルタ係数を等しくするという束縛条件を加えて信号語分割フィルタを設計するものである。これにより入力信号を分割することによる加算器の増加が抑えられ、従来法よりもハードウェアのコストを抑えることが可能であることを確認した。
- 社団法人電子情報通信学会の論文
- 2000-06-16
著者
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西原 明法
東京工業大学教育工学開発センター
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西原 明法
東京工業大学 工学部情報工学科
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細川 晃平
東京工業大学 理工学研究科 電子物理工学専攻
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柳生 光彦
株式会社テキサス・インスツルメンツ筑波研究開発センター
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柳生 光彦
東京農工大学電気電子工学科
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