Alpha-chipマシン上のPHL処理系について(<特集>並列・分散)
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概要
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PHL(Portable Hashed Lisp)は32ビット計算機を対象に設計されたLisp処理系である。本論では64ビットアーキテクチャであるAlpha-chip上のPHLのデータ表現とその実装法を述べ、新たに作成した圧縮型ガーベッジコレクションについての評価も述べる。ガーベッジコレクションは世代別管理方式を応用し、不使用セル全体の回収を行わず、最近に使用されたセルの局所性を高めることを実現する。このガーベッジコレクションによってPHL処理系の処理時間の短縮が実現されている。
- 一般社団法人情報処理学会の論文
- 1998-03-23
著者
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