マルチマイクロプロセッサシステムα-16のアーキテクチャ
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概要
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安価な1チップμP(マイクロプロセッサ)を複数結合して, 演算処理能力を高める方法の一つに, 共有バス結合による資源共有型システムがある. この方式は, 各μPの機能を均質にできること, 処理アルゴリズムに柔軟性があること等により, 小規模システムで広く用いられている. しかし, 接続可能なμPの台数に物理的制限があり, 処理能力の向上を困難にしている. 本報告では, 安価で容易に入手可能な1チップ汎用μPを用い, これを比較的多数(数十台)接続できる多重化共有バス結合のマルチμPシステムα-16のアーキテクチャについて述べる. α-16では, 共有バスのアクセス方式を簡易化して, ソフトウェアの負担を軽減し, 低性能のμPで複数の共有バスを能率よく利用できるようにした. また, 非同期2進木バスアービタの採用によって, 同一共有バスでの複数μPのアクセス競合を短時間O(log_2 n)で調停し, 共有バス利用時のオーバヘッドを極力減少させている. さらに, μP相互の通信制御, 共有資源利用時の相互排他的制御などのハードウェア化により, プログラミングの負担の軽減も図っている. α-16によるFFT(高速フーりエ変換)の並列処理例では, μPの使用台数に比例した処理速度が得られている.
- 一般社団法人情報処理学会の論文
- 1984-07-15
著者
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