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東京大学大規模集積システム設計教育研究センター | 論文
- システムレベル設計記述に対する具体値・記号値シミュレーションによる入力パターンの自動生成手法(SoC・解析,組込技術とネットワークに関するワークショップETNET2008)
- 1M-5 ワードレベル論理式の充足可能性判定問題を利用したシステムレベル設計デバッグ支援手法(モデリング・上流設計,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 専用プロセッサ用命令セットの自動生成手法の提案と実装
- 実装技術の時代
- PMOS/NMOSのプロセスばらつきを独立に検出するためのリング型バッファチェインを用いたオンチップモニタ(アナログ,アナデジ混載,RF及びセンサインタフェース回路)
- 潜在的多様性を考慮したプログラマブルハードウェアの高位合成手法(プログラマブルデバイスと設計技術,システムオンシリコンを支える設計技術)
- A "Variable Capacitance" Circuit for Tuning Integrated Filters and Oscillators
- D-12-25 Bayesian MCMC オンライン署名照合
- C-12-43 有線 CDMA インターフェースシステムの検討
- C-12-33 CMOS スイッチトキャパシタ DC-DC コンバータ
- A-7-11 相対ペントラジェクトリーによるオンライン署名照合
- A 500MS/sec -54db THD Open-Loop CMOS Sample-and-Hold Stage
- C-12-25 A Highly Linear Open-Loop Full CMOS High-Speed Sample-and-Hold Stage
- C-12-4 SoCのオンチップテストのためのプログラム環境(C-12.集積回路A(設計・テスト・実装技術),一般講演)
- 有機トランジスタとプラスチックMEMSスイッチを集積化した無線電力伝送シート向けの回路技術(アナログ・デジアナ・センサ,通信用LSI)
- 設計固有セルライブラリの自動生成手法(論理設計,デザインガイア2009-VLSI設計の新しい大地)
- Increasing yield using partially-programmable circuits (VLSI設計技術)
- Increasing yield using partially-programmable circuits (ディペンダブルコンピューティング)
- チップ内プログラマブル配線向け形式的検証手法(暗号処理回路,システムオンシリコンを支える設計技術)
- リンク長及びレイテンシ制約下でのネットワークオンチップのトポロジ自動生成(ネットワークオンチップ,システムオンシリコンを支える設計技術)
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