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(株)ルネサステクノロジシステムソリューション統括本部システムコア技術統括部 | 論文
- Slightly Boostingを用いた5.3GB/sロジック混載用SDRAMコアの開発
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- センス同期式書き込み/読出し方式回路を搭載したSRAM I/F混載DRAMコア(MRAM,不揮発メモリ,メモリ,一般)
- DRAM混載システムLSIの現状と今後の動向
- モデルベース開発とPILS(Processor In Loop Simulation)を活用した組込み向け超並列プロセッサのソフトウェア開発
- SIMD型アクセラレータのJPEG2000エンコーダによる性能評価(デバイスアーキテクチャII, リコンフィギャラブルシステム, 一般)
- 256MビットDRAMチップ (特集"LSI") -- (メモリ)
- SoC組み込み用超並列プロセッサ(MX)のリアルタイム画像処理への応用
- 4. SoC組込み向け超並列プロセッサMXによる画像処理・画像認識の実現(最先端メディアプロセッサが拓く映像処理)