小西 奈緒 | 芝浦工業大学大学院理工学研究科

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概要

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関連著者

• 宇佐美 公良

  芝浦工業大学

• 小西 奈緒

  芝浦工業大学大学院理工学研究科

• 宇佐美 公良

  芝浦工業大学工学部

• 工藤 優

  芝浦工業大学

• 並木 美太郎

  東京農工大学

• 天野 英晴

  慶應義塾大学

• 宇佐美 公良

  芝浦工業大学情報工学科

• 天野 英晴

  慶應義塾大学大学院理工学研究科開放環境科学専攻コンピュータ科学専修

• 太田 雄也

  芝浦工業大学 工学部 情報工学科

• 坂本 龍一

  東京農工大学

• 松永 健作

  芝浦工業大学大学院理工学研究科

• 宇佐美 公良

  株式会社 東芝 セミコンダクター社

• 宇佐美 公良

  芝浦工業大学工学部情報工学科

• 小西 奈緒

  芝浦工業大学工学部情報工学科

• 工藤 優

  芝浦工業大学工学部情報工学科

• 小西 奈緒

  芝浦工業大学工学情報工学科

• 工藤 優

  芝浦工業大学工学情報工学科

• 工藤 優

  芝浦工業大学大学院理工学研究科電気電子情報工学専攻

• 小西 奈緒

  芝浦工業大学大学院理工学研究科電気電子情報工学専攻

• 坂本 龍一

  東京農工大学工学部

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著作論文

• 超低電圧領域における最適加算器アーキテクチャの検討(低電力設計,デザインガイア2010-VLSI設計の新しい大地-)
• 超低電圧領域における最適加算器アーキテクチャの検討(低電力設計,デザインガイア2010-VLSI設計の新しい大地-)
• 加算器アーキテクチャ比較評価のための消費エネルギー解析モデルの提案(低消費電力設計,デザインガイア2012-VLSI設計の新しい大地-)
• 加算器アーキテクチャ比較評価のための消費エネルギー解析モデルの提案(低消費電力設計,デザインガイア2012-VLSI設計の新しい大地-)
• オンチップ・リークモニタによるランタイム・パワーゲーティングの制御にむけた損益分岐点の評価(応用設計, FPGA応用及び一般)
• オンチップ・リークモニタによるランタイム・パワーゲーティングの制御にむけた損益分岐点の評価(応用設計, FPGA応用及び一般)
• オンチップ・リークモニタによるランタイム・パワーゲーティングの制御にむけた損益分岐点の評価(応用設計, FPGA応用及び一般)

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