A-1-12 Verilog HDLを用いた万能量子論理ゲートのエミュレータ回路設計に関する考察(A-1.回路とシステム,一般セッション)

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概要

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• 2012-08-28

著者

• 島袋 勝彦

  琉球大学

• 金城 光永

  琉球大学

• 十川 雄一郎

  琉球大学大学院理工学研究科

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