ブロック処理とリフティング法に基づく二次元非分離GenLOTのハードウェア実装(システムと信号処理及び一般)
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概要
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本報告では,ブロック処理とリフティング法に基づく二次元非分離GenLOTのハードウェア実装のためのアーキテクチャを提案する.JPEGやMPEG-2で採用されている離散コサイン変換(DCT)やJPEG2000で採用されている離散ウェーブレット変換(DWT)は可分離処理のため,斜め方向のテクスチャやエッジの表現に適さない.筆者らが先に提案した非分離GenLOTは,指向性を与えることが可能であり,斜め方向のテクスチャやエッジ表現に適している.また,直交性を維持しながらブロック毎の処理を行うことが可能である.しかしながら,非分離GenLOTには処理速度の向上に課題が残されている.この課題を解決するためには,専用ハードウェアによる処理が有効である.そこで本研究では,二次元非分離GenLOTをブロック処理とリフティング法によって実現するハードウェアアーキテクチャを提案する.ハードウェアへ実装する回路部分をVHDLへコーディングし,回路合成を行い,回路面積と速度の評価を行う.
- 2011-06-23
著者
-
菊池 久和
新潟大学工学部電気電子工学科
-
村松 正吾
新潟大学工学部電気電子工学科
-
菊池 久和
新潟大学大学院自然科学研究科電気情報工学専攻
-
村松 正吾
新潟大学大学院自然科学研究科電気情報工学専攻
-
菊池 久和
新潟大学工学部
-
村松 正吾
新潟大学工学部
-
崔 セミ
仁荷大学it工科大学電子工学部
-
太田 優也
新潟大学工学部電気電子工学科
-
村松 正吾
新潟大学 工学部電気電子工学科
-
崔 セミ
仁荷大学it工科大学 電子工学部
-
村松 正吾
新潟大学自然科学系(工学部)
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