block-LIMに基づくCMOS素子を含む大規模回路網の高速解析手法(回路,EMC,一般)
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概要
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非線形能動素子を含む大規模回路網の解析に対して,従来の行列演算に基づくSPICE系シミュレーションでは,莫大な計算コストを必要とする.大規模線形回路網を高速・高精度に解析する手法として,block-Latency Insertion Method (block-LIM)が提案されている.block-LIMはSPICE系シミュレータと比較して数十倍から数百倍の高速な解析が可能である.しかしながら,非線形能動回路へblock-LIMを応用した報告例はない.本稿では,block-LIMのアルゴリズムを拡張し,CMOS回路を含む大規模回路解析へ応用するための手法を提案し,その評価を行う.
- 2011-06-17
著者
-
浅井 秀樹
静岡大学大学院工学研究研究科
-
關根 惟敏
静岡大学創造科学技術大学院
-
黒部 裕貴
静岡大学大学院工学研究科
-
浅井 秀樹
静岡大学創造科学技術大学院:静岡大学工学部
-
樋澤 佑修
静岡大学大学院工学研究科
-
樋澤 佑修
静岡大 大学院工学研究科
-
浅井 秀樹
静岡大学工学部システム工学科
-
浅井 秀樹
静岡大学大学院工学研究科システム工学専攻:静岡大学工学部システム工学科
-
浅井 秀樹
静岡大学大学院光学研究科:静岡大学創造科学技術大学院:静岡大学工学部システム工学科
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