FPGAによる雑音除去ファジーフィルタの実装(ソフトコンピューティング,一般)
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概要
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本稿では,FPGAを用いたボケ復元のウィナーフィルタと混合雑音除去のファジーフィルタの実時間処理のハードウェア化を提案する.しかしながら,ファジーフィルタは非常に規模が大きく,ハードウェア容量を何らかの方法で削減する必要がある.本稿ではファジーフィルタの性能を落とさず,ハードウェアの工夫によってFPGAの容量の削減を行ったので報告する.
- 2010-02-25
著者
-
木村 誠聡
神奈川工科大学情報学部情報工学科
-
中村 幸弘
神奈川工科大学
-
片山 卓也
神奈川工科大学
-
穐本 和昌
京セラ株式会社
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片山 卓也
神奈川工科大学情報学部情報工学科
-
木村 誠聡
神奈川工科大学大学院情報工学専攻
-
中村 幸弘
神奈川工科大学情報学部情報工学科
-
木村 誠聡
神奈川工科大学大学院
-
木村 誠聡
神奈川工科大学
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