FPGAとCellプロセッサによるFDTD法の高速計算(2008年度論文奨励賞受賞記念論文)
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概要
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本論文では,FPGA実装およびCellプロセッサ上のFDTD法において,時空間パイプラインという新しいアルゴリズムを提案する.時空間パイプラインは従来の並列計算アルゴリズムの計算順序を変更することにより,メモリアクセスのボトルネックを解消し高速に計算できるという特長を持つ.本論文では,本手法を用いて一次元FDTD法のFPGAおよびCellプロセッサへの実装を行う.この結果,時空間パイプラインはメモリアクセスのボトルネックを解消でき,従来の並列計算に比べFDTD法の高速化に有効であることを示す.
- 2010-08-30
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