CIP法のFPGA実装における時空間パイプラインによる高速化
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概要
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著者らはこれまで,FDTD法のFPGA実装において時空間パイプラインという新しいハードウェアアルゴリズムを提案し,従来の並列計算より高速に計算できることを示した.一方,近年電磁界解析手法として提案されたCIP法は,従来のFDTD法より高精度であり,FDTD法と同一精度ではより小さい計算コストでの計算が期待できる.本報告では,電磁界解析の高速化のため,時空間パイプラインを用いてCIP法のFPGA実装を行う.また,PCにおけるCIP法およびFPGA実装におけるFDTD法と比較し,時空間パイプラインを用いたCIP法の低コスト性を示す.
- 2009-01-14
著者
-
遠藤 翔
仙台電波工業高等専門学校専攻科電子システム工学専攻
-
園田 潤
仙台電波工業高等専門学校電子工学科
-
遠藤 翔
仙台高等専門学校専攻科電子システム工学専攻
-
佐藤 源之
東北大学東北アジア研究センター
-
佐藤 源之
東北大学
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