トレリスシェイピングを用いたPSK信号のピーク電力低減法のFPGA実装及び性能評価(移動通信ワークショップ)
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概要
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近年の通信システムへの最も大きな需要は,大容量化である.その流れの中で,周波数利用効率および電力利用効率が優れた方式が模索されている.しかし,一般に周波数利用効率のよい方式では,信号のピーク電力の変動が大きくなるために,電力増幅器による高効率な線形増幅が困難になる.この傾向はOFDMなどのマルチキャリア方式において顕著に現れる.そのため,次世代移動体通信の上り回線では周波数等化と組み合わされたシングルキャリア方式の適用が有力とされている.シングルキャリア方式において周波数利用効率を高める手段には波形整形フィルタのロールオフ係数を下げることが有効であるが,その結果,シングルキャリア方式においても無視することのできないピーク電力が発生する.そこで著者らは,トレリスシェイピングを用いたシングルキャリアPSK変調に対するピーク電力低減手法を提案し,ハードウェア実装を行ってきた.本稿では,提案手法をハードウェア記述言語を用いてFPGA回路上で実装し,その実測値とコンピュータシミュレーションの結果との比較を通して,提案手法の性能を評価する.
- 2009-02-25
著者
-
落合 秀樹
横浜国立大学大学院
-
棚橋 誠
横浜国立大学工学部
-
落合 秀樹
横浜国立大学
-
北川 裕之
横浜国立大学大学院工学府
-
棚橋 誠
横浜国立大学工学府
-
棚橋 誠
横浜国立大学大学院工学府
-
棚橋 誠
横浜国立大学大学院 工学府
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