高性能差分法計算のためのFPGAアレイにおけるFPGA間通信機構の検討(チップ間通信,ルーティング,インターコネクト,デザインガイア2008-VLSI設計の新しい大地)
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概要
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本研究では,差分法を高速に計算できるアレイ型専用計算機を提案している.本計算機は計算要素(PE)のアレイ構造により,PE数に比例した計算性能を持つ.現在,高性能計算を実現するために,大規模アレイを複数のFPGAからなるFPGAアレイにより実装することを検討している.これまでの調査の結果,FPGAアレイに実装される専用計算機の性能は隣接FPGA間のI/O帯域により制約される可能性があることが明らかとなった.本論文では,実際の計算ではFPGA間に要求される帯域を十分に小さくできることを示し,これを実現するFPGA間通信機構について検討する.
- 社団法人電子情報通信学会の論文
- 2008-11-10
著者
-
山本 悟
東北大学大学院情報科学研究科
-
山本 悟
東北大学
-
佐野 健太郎
東北大学大学院情報科学研究科
-
初田 義明
東北大学大学院情報科学研究科
-
王 陸洲
東北大学大学院情報科学研究科
-
中村 維男
東北大学大学院情報科学研究科
-
中村 維男
東北大
-
山本 悟
東北大学大学院
-
中村 維男
東京工業大学
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