不感帯防止位相比較回路を用いた低消費電力PLL(デモ展示・ポスター講演,ネットワークプロセッサ,通信のための信号処理,無線LAN/PAN,一般)
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概要
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The accurate- and low jitter- PLLs are required to realize a high-speed wireless communication system. The PFD, which detects the phase and frequency difference between input and VCO output signals in the PLL, has the problem of its limited resolution called Dead Zone (DZ). It is generally known that this DZ degenerates the open loop gain of a PLL. In this article, the effect of DZ against the PLL is analyzed and a phase detection technique using multi-phase VCO is proposed to alleviate DZ.
- 社団法人電子情報通信学会の論文
- 2008-02-29
著者
-
小林 由佳
東京工業大学統合研究院
-
板倉 哲朗
(株)東芝研究開発センター
-
小林 由佳
東京工業大学総合研究院益研究室
-
崔 明秀
(株)東芝研究開発センターモバイル通信ラボラトリー
-
板倉 哲朗
(株)東芝 研究開発センター
-
崔 明秀
(株)東芝研究開発センター
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