2次系の過渡現象を抑圧した高速周波数引き込みPLL周波数シンセサイザ
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概要
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PLL周波数シンセサイザは周波数切り換え時,2次系の過渡現象を生じる.そのため直接合成方式周波数シンセサイザやDirect Digital Synthesizer(DDS)と比較して周波数引き込み時間が長くなる.本論文では周波数検出回路とチャージコントローラを用いてPLL周波数シンセサイザの2次系の過渡現象を抑圧し,高速周波数引き込みを実現する手段を示す.実験結果より本PLL周波数シンセサイザでは,基準周波数10サイクルで周波数引き込みが実現できる.
- 社団法人電子情報通信学会の論文
- 1997-03-06
著者
-
副井 裕
鳥取大学工学部
-
津田 和俊
鳥取大学
-
鷲見 育亮
鳥取三洋電機
-
鷲見 育亮
鳥取三洋電機株式会社 研究開発本部
-
尾保手 茂樹
鳥取大学工学部
-
奈良井 健太
鳥取大学工学部
-
津田 和俊
鳥取大学工学部
-
菖蒲 康一
鳥取大学工学部
-
奈良井 健太
鳥取大学
-
菖蒲 康一
鳥取大学
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