周波数検出方式高速化回路による高速周波数引き込みPLL周波数シンセサイザ
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概要
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近年, 移動体通信端末において局部発振回路に用いるPLL周波数シンセサイザの周波数引き込み時間の短縮が求められている. 本論文では, PLL周波数シンセザイザの周波数引き込み時間の短縮方式を提案する.
- 社団法人電子情報通信学会の論文
- 1997-03-06
著者
-
副井 裕
鳥取大学工学部
-
津田 和俊
鳥取大学
-
尾保手 茂樹
鳥取大学
-
奈良井 健太
鳥取大学工学部
-
菖蒲 康一
鳥取大学工学部
-
鷲見 育亮
烏取三洋電機 (株)
-
奈良井 健太
鳥取大学
-
副井 裕
鳥取大学 工学部
-
菖蒲 康一
鳥取大学
-
副井 裕
鳥取大学
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