デバイス・シミュレーション・エンジンの一構成法
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概要
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高速でかつ安価なデバイス・シミュレーション専用のハードウェアの構成について検討した結果を報告している.離散化されたデバイス方程式の格子点上の未知変数の計算にはFPGAを用い, 未知変数の格納にはFPGA内部のSRAMを用いるという方法で部品数を削減するという現実的な構成方法を提案している.デバイス方程式に先だって, ポアソン方程式の数値解析を取り上げ実装の検討を行った.またスタティック・タイミング・アナライザとタイミング・シミュレータを用いた予備的な評価も行なっている.
- 社団法人電子情報通信学会の論文
- 1998-12-10
著者
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山本 利雄
明治大学理工学部情報科学科
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冨田 栄作
明治大学理工学部情報科学科
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冨田 栄作
明治大学 理工学部 情報科学科
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山本 利雄
明治大学 理工学部 情報科学科
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井口 幸洋
明治大学 理工学部 情報科学科
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