出力バッファ型光パケットスイッチにおける並列バッファ管理方式 : 同期到着固定長パケットの場合(IPバックボーンネットワーク,フォトニックネットワーク及び一般)
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概要
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出力バッファ型光パケットスイッチにおける高速バッファ管理手法について検討する.並列処理とパイプライン処理を組みあわせた制御アルゴリズムを提案する.ポート数Nに依存しない計算量O(1)の提案アルゴリズムにより,従来のN倍の高速化を図れる.回線速度40Gbpsの8×8光パケットスイッチにおいて,64バイトの固定長パケットを処理できる機能をFPGAに実装できることをシミュレーションによって確認する.また,提案方式とFPGA技術を用いて512×512光パケットスイッテをサポートできることを示す.
- 社団法人電子情報通信学会の論文
- 2003-07-11
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