並列計算機ADENA用自動並列化コンパイラ: APARC : 概要
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概要
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ADENA(Alternating Direction Edition Nexus Array:交互方向編集アレイ)は、科学技術分野における数値シミュレーションを高速に処理することを目的として開発されたMIMD型並列計算機で、そのハードウェアは1台のホスト計算機と2次元的に配置された多数のPE(プロセッサエレメント)からなるADENAキューブ及びADENA用ネットワーク(HyperCross Net)から構成される。並列計算機システムのプログラミング手法には、大きく2つの方法がある。一つは並列記述言語を用い陽に並列動作を記述するものである。もう一つは逐次型言語で記述されたプログラムを自動並列化コンパイラにより並列プログラムに変換するアプローチである。現在我々は自動並列化コンパイラAPARC(Adetran PARallelizing Computer)を開発中であり、これはFORTRANプログラムを、FORTRANに並列動作記述の構文を加えたADETRAN[4]プログラムに変換するものである。APARCは、プログラム中のdoループを検出し、制御構造を解析する。そしてデータ参照関係解析によって並列化を行っている。特に、doループ中に分岐命令やスカラー変数があっても、並列化の対象としている。本稿では、制御構造解析を中心にその概要について報告する。
- 一般社団法人情報処理学会の論文
- 1991-02-25
著者
-
廉田 浩
九州大学大学院 芸術工学研究院
-
若谷 彰良
甲南大学知能情報学部
-
廉田 浩
松下電器産業(株)半導体開発本部
-
若谷 彰良
甲南大学理工学部
-
岡本 理
松下電器産業(株) 中央研究所
-
黒田 茂
株式会社松下ソフトリサーチ
-
村木 幸治
松下電器産業株式会社
-
若谷 彰良
松下電器産業株式会社
-
岡本 理
松下電器産業
-
若谷 彰良
松下電器産業
-
廉田 浩
松下電器産業
-
廉田 浩
九大 大学院芸術工学研究院
-
村木 幸治
松下電器産業
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