高速並列画像処理用の再構成可能プロセッサエレメントの提案(リコンフィギャラブルプロセッサ,リコンフィギャラブルシステム,一般)
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概要
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多様な算術演算をサポートする再構成型要素プロセッサを持つ高速画像処理用の新しい並列アーキテクチャを提案する.このアーキテクチャは特に三次元モデルを使ったグラフィック処理や画像認識処理などに適している.この要素プロセッサは26個の4ビット加減算器やその他の多くの基本的なサブユニットから構成されている.これらのサブユニット間および要素プロセッサ間の接続はクロスバ網や選択回路によって実現されている.コンフィギュレーションデータに従ってこれらの接続スイッチを変えることで,整数の加減算器・乗算器から浮動小数点加減算器・乗算器まで再構成可能な要素プロセッサとなる.250MHzクロック動作の場合1要素あたりのピーク性能は,(8ビット整数積和)1BOPS,または(単精度浮動小数点積和)125MFLOPSとなる
- 2007-05-10
著者
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