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立命館大学院理工学研究科 | 論文
- C-037 ソフトウェア・ハードウェア連動配置手法(C分野:アーキテクチャ・ハードウェア)
- 進化的手法による高速学習を実現する専用エンジンアーキテクチャ
- シーケンスペアに基づく交叉専用アーキテクチャの設計(応用1, FRGAとその応用及び一般)
- クロストークノイズの低減を指向した配置手法(設計・検証, FRGAとその応用及び一般)
- シーケンスペアに基づく交叉専用アーキテクチャの設計(応用1, FRGAとその応用及び一般)
- クロストークノイズの低減を指向した配置手法(設計・検証, FRGAとその応用及び一般)
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- クロストークノイズの低減を指向した配置手法(設計・検証, FRGAとその応用及び一般)
- 遺伝的アルゴリズムに基づくフロアプラン専用エンジンアーキテクチャとその評価
- ビアプログラマブルデバイスVPEXの配線遅延評価(プログラマブルデバイスと設計技術,システムオンシリコンを支える設計技術)
- 各種暗号処理に適した2入力LUTアレイ型プログラマブルロジックアーキテクチャの検討(HPCとアーキテクチャ,デザインガイア2009 VLSI設計の新しい大地)
- ビアプログラマブルデバイスに最適な基本論理ゲートアーキテクチャの検討(プログラマブルデバイスと設計技術,システムオンシリコンを支える設計技術)
- ビアプログラマブルデバイスVPEXのロジックアレイブロックと配線アーキテクチャの検討(プログラマブルデバイスと設計技術,システムオンシリコンを支える設計技術)
- ビアプログラマブルデバイスVPEXのロジックエレメント改良による面積削減と高性能化(学生・若手研究会)
- SoC埋め込み型プログラマブルロジックePLXのネットワークセキュリティ処理への応用(スマートパーソナルシステム,一般)
- B-20-27 高周波画像を用いたスマートフォン用非可視化コードとその応用(B-20.ユビキタス・センサネットワーク,一般セッション)
- A-1-3 超並列SIMD型プロセッサMX-1のためのガロア体演算によるAES用SubBytes変換の高速化(A-1.回路とシステム,一般セッション)
- A-1-2 超並列SIMD型演算プロセッサMX-1へのMersenne Twisterの実装(2)(A-1.回路とシステム,一般セッション)
- A-1-1 超並列SIMD型演算プロセッサMX-1へのMersenne Twisterの実装(1)(A-1.回路とシステム,一般セッション)
- Ribonuclease A の加圧による巻き戻り : 分光測定と熱測定との比較
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