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東京工業大学工学部電気・電子工学科 | 論文
- Reduct-Seq表現による高速な一般構造フロアプラニング
- CAS2000-15 / VLD2000-24 / DSP2000-36 Reduct-Seq表現による高速な一般構造フロアプランニング
- CAS2000-15 / VLD2000-24 / DSP2000-36 Reduct-Seq表現による高速な一般構造フロアプラニング
- クリティカルパスのリビジットに着目した回路分割遅延改善手法の提案
- 最小カットを用いて適切な部分回路を抽出するための効率的手法
- 最小カットを用いて適切な部分回路を抽出するための効率的手法
- 最小カットを用いて適切な部分回路を抽出するための効率的手法
- マルチプロセッサの低消費電力化のためのクロックON/OFFスケジューリング
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- 最大フロー手法を応用した論理回路モデルグラフの最小カット列挙法と回路分割手法
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- マルチプロセッサの低消費電力化のためのクロックON/OFFスケジューリング
- 最大フロー手法を応用した論理回路モデルグラフの最小カット列挙法と回路分割手法
- 準同期式設計法を用いたプロセッサ設計
- 準同期式設計法を用いたプロセッサ設計
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- 高次SACのベクトル出力ブール関数への拡張
- トラック数制約下におけるWSI上ネットワーク再構成
- OMVPE 成長 GaInAs/InP ヘテロ界面の成長中断による制御の可能性
- AFMによるOMVPE成長GaInAs/InP共鳴トンネルダイオードのヘテロ界面の観察