リターンアドレスの改ざん検出機能を備えたマイクロプロセッサアーキテクチャ(計算機システム)
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概要
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プログラムの実行時にリターンアドレスの改ざんを検出する機構を備えたマイクロプロセッサアーキテクチャを提案する.プロセッサコアの外部にリターンアドレスを管理するための専用プロセッサ(RAMP)を設け,その上で動作するソフトウェアを用いてリターンアドレスの改ざんを検出する.これにより,(i)ユーザプログラムに対する変更の必要性を回避しながら,(ii)C言語のlongjmp関数やC++の例外処理などの非局所分岐に対しても誤検出することなく,リターンアドレスの改ざんを正確に検出することが可能となり,更に,(iii)プロセッサコアとRAMPとの並列動作によって,検出処理のオーバヘッドを隠ぺいできる.また,RAMPを周辺コントローラの一種とみなせるインタフェースを設けることで,OSに対しても扱いやすいシステム構成とする.シミュレーションによる性能評価の結果,本方式の適用によるプログラムの実行性能の低下は最大でも2.61%に抑えられることを確認した.
- 2014-03-01
著者
-
平田 博章
京都工芸繊維大学大学院工芸科学研究科
-
布目 淳
京都工芸繊維大学大学院工芸科学研究科
-
平田 博章
京都工芸繊維大学大学院 工芸科学研究科情報工学部門
-
柴山 潔
京都工芸繊維大学大学院 工芸科学研究科情報工学部門
-
中務 国男
京都工芸繊維大学大学院工芸科学研究科情報工学専攻
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